到岗时间：不限
年龄要求：不限
性别要求：不限
婚况要求：不限
岗位职责：1、与算法工程师紧密配合实现matlabmode,cmode2、沟通项目及产品需求并转换为FPGA实现岗位要求：1、熟练掌握verilog/vhdl；2、对通信原理、信号处理、自动控制、数字电路、模拟电路有较好理解，具有相关设计和调试项目经验3、具有ARM FPGA协同架构（如ZYNQ）开发经验者优先4、良好的英文能力，具有良好的自学能力；5、通信工程、电子信息技术、微电子、自动化等相关专业，本科以上学历。
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